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（已有0条评价） - 电子书：集成电路静态时序分析与建模
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基本信息
内容简介
由于芯片尺寸的减小、集成度密集化的增强、电路设计复杂度的增加、电路性能要求的提高等因素，对芯片内的时序分析提出了更高的要求。静态时序分析是大规模集成电路设计中非常重要的一个环节，它能验证设计在时序上的正确性，并决定设计是否能够在要求的工作频率下运行。本书由集成电路设计专业论坛www.icdream.com站长刘峰编著，共11章，基于广度和深度两个方面来阐述整个CMOS集成电路静态时序分析流程与时序建模技术，并通过实践案例对技术应用进行更深入的讲解，使初学者在静态时序分析与建模两方面得到理论与实战的双重提高。本书适合作为微电子与集成电路相关专业的研究生、本科生、职业技术类学生的教材和教辅书，也可作为电子、自控、通信、计算机类工程技术人员学习使用集成电路设计软件和进修集成电路设计的专业技术参考书与工具书。
作译者
刘峰，EETOP社区【后端设计】设计分论坛版主，拥有10年以上集成电路后端设计工程经验。目前主要从事集成电路后端设计的研究和开发工作，先后供职于多家国内外知名集成电路设计公司和科研院所，参与了多项国家863计划、核高基重大科技项目和重要的产品的研发。
目录
前言
第1章 引论 1
1.1 集成电路发展史简介 1
1.2 国内集成电路的发展现状 2
1.3 国际集成电路的发展态势 4
1.4 静态时序分析技术 4
1.4.1 静态时序分析简介 4
1.4.2 静态时序分析背景 4
1.4.3 静态时序分析的优缺点 5
1.5 主流静态时序分析与建模工具介绍 6
第2章 静态时序分析的基础知识 9
2.1 逻辑门单元 9
2.2 门单元的时序计算参数 10
2.3 时序单元相关约束 12
2.4 时序路径 14
2.5 时钟特性 17
2.6 时序弧 19
2.7 PVT环境 24
2.8 时序计算单位 28
第3章 单元库时序模型 29
第1章 引论 1
1.1 集成电路发展史简介 1
1.2 国内集成电路的发展现状 2
1.3 国际集成电路的发展态势 4
1.4 静态时序分析技术 4
1.4.1 静态时序分析简介 4
1.4.2 静态时序分析背景 4
1.4.3 静态时序分析的优缺点 5
1.5 主流静态时序分析与建模工具介绍 6
第2章 静态时序分析的基础知识 9
2.1 逻辑门单元 9
2.2 门单元的时序计算参数 10
2.3 时序单元相关约束 12
2.4 时序路径 14
2.5 时钟特性 17
2.6 时序弧 19
2.7 PVT环境 24
2.8 时序计算单位 28
第3章 单元库时序模型 29
前言
在当今信息化的社会中，集成电路已成为各行各业实现信息化、智能化的基础。无论是军用还是民用，它都起着不可替代的作用。集成电路产业是全球范围内的核心高科技产业之一，具有战略性和市场性双重特性。在国防和国家安全领域，集成电路起着维护国家利益、捍卫国家主权安全的关键作用；在经济建设和增强综合国力的过程中，集成电路又是核心竞争力的具体表现。自20世纪中期以来，集成电路产业遵循摩尔定律飞速发展。集成电路产业的兴起奠定了现代信息技术的基础，现代信息技术正在迅速地改变世界及人们的生活方式，没有半导体技术及集成电路突飞猛进的发展，就没有信息技术日新月异的变化。
集成电路静态时序分析与建模技术是集成电路设计中的关键技术，高性能级芯片都需要先进的静态时序分析与建模技术来支撑。
全书共11章，其中静态时序分析与建模的详细内容通过第2～11章进行讲解。
第1章引论
简单介绍集成电路发展状态和重要性，使读者对集成电路行业有初步了解。同时，简单介绍业界主流的静态时序分析与建模的设计工具，使读者对静态时序有更广阔的视野。
第2章静态时序分析的基础知识
随着芯片尺寸的减小、集成度密集化的增强、电路设计复杂度的增加、电路性能要求的提高等，对芯片内的时序分析提出了更高的要求。静态时序分析是大规模集成电路设计中非常重要的一个方面，想熟练掌握静态时序分析，需要从掌握最基本的时序分析概念开始。因此，这一章向读者介绍静态时序分析的基本知识。
第3章单元库时序模型
在时序分析过程中，对一个复杂芯片中的每一个模块，不论是简单的标准单元（如NAND、NOR等），还是复杂的定制化设计模块（如RAM或处理器核），都需要有一个时序模型。因此，这一章向读者介绍单元库时序模型的基本理论。
第4章时序信息库文件
时序信息库文件中记录着逻辑门延时、输出信号转换延时和功耗等信息，这些信息在时序分析时被调用，以计算电路延时值和功耗值。时序文件的内容主要由库组、属性和因子等组成。因此，这一章向读者介绍时序信息库文件中的主要基本理论。
第5章静态时序分析的基本方法
时序分析的目的是验证设计是否符合规定时序约束下的性能要求，同时设计者基于时序分析的结果，决定如何在不满足时序要求的情况下进行时序性能改进。为了熟练地通过时序分析结果找到关键的时序违反路径并进行优化，就必须了解时序分析的基本方法。因此，这一章向读者介绍静态时序分析的基本方法。
第6章时序约束
静态时序分析工具以时序约束作为判断设计中的时序是否满足设计要求的标准，因此设计者需要提供正确的时序约束信息，以便静态时序分析工具输出正确的时序报告。通过SDC可以使用简单而又直接的方法来描述未来设计中芯片工作时所预期的时序约束，SDC的格式也是一种业界标准。因此，这一章向读者介绍主要的时序约束理论知识。
第7章串扰噪声
集成电路进入超深亚微米设计后，串扰噪声已经成为影响芯片功能和性能的重要原因之一，因此合理解决串扰噪声带来的不利影响是当前集成电路设计必须面对的越来越重要的问题。因此，这一章向读者介绍时序分析中串扰噪声的基本理论和相关的分析技术。
第8章单元时序建模实战
原理图和版图设计完成后，时序分析工具需要读取该设计的时序信息，如综合工具需要知道模块的逻辑功能、单元实际的输入负载电容、不同输入斜率和输出负载情况下单元的延时与功耗，以及单元的面积等，单元时序信息特征化就是用模拟仿真器来提取设计模块有关以上信息的过程。通过时序信息特征化来提供设计模块的时序数据，以供多种时序分析工具使用。因此，这一章向读者介绍标准单元特征化设计在实际工程应用中的基本设计技术。
第9章静态时序分析实战（ETS篇）
集成电路静态时序分析与建模技术是集成电路设计中的关键技术，高性能级芯片都需要先进的静态时序分析与建模技术来支撑。
全书共11章，其中静态时序分析与建模的详细内容通过第2～11章进行讲解。
第1章引论
简单介绍集成电路发展状态和重要性，使读者对集成电路行业有初步了解。同时，简单介绍业界主流的静态时序分析与建模的设计工具，使读者对静态时序有更广阔的视野。
第2章静态时序分析的基础知识
随着芯片尺寸的减小、集成度密集化的增强、电路设计复杂度的增加、电路性能要求的提高等，对芯片内的时序分析提出了更高的要求。静态时序分析是大规模集成电路设计中非常重要的一个方面，想熟练掌握静态时序分析，需要从掌握最基本的时序分析概念开始。因此，这一章向读者介绍静态时序分析的基本知识。
第3章单元库时序模型
在时序分析过程中，对一个复杂芯片中的每一个模块，不论是简单的标准单元（如NAND、NOR等），还是复杂的定制化设计模块（如RAM或处理器核），都需要有一个时序模型。因此，这一章向读者介绍单元库时序模型的基本理论。
第4章时序信息库文件
时序信息库文件中记录着逻辑门延时、输出信号转换延时和功耗等信息，这些信息在时序分析时被调用，以计算电路延时值和功耗值。时序文件的内容主要由库组、属性和因子等组成。因此，这一章向读者介绍时序信息库文件中的主要基本理论。
第5章静态时序分析的基本方法
时序分析的目的是验证设计是否符合规定时序约束下的性能要求，同时设计者基于时序分析的结果，决定如何在不满足时序要求的情况下进行时序性能改进。为了熟练地通过时序分析结果找到关键的时序违反路径并进行优化，就必须了解时序分析的基本方法。因此，这一章向读者介绍静态时序分析的基本方法。
第6章时序约束
静态时序分析工具以时序约束作为判断设计中的时序是否满足设计要求的标准，因此设计者需要提供正确的时序约束信息，以便静态时序分析工具输出正确的时序报告。通过SDC可以使用简单而又直接的方法来描述未来设计中芯片工作时所预期的时序约束，SDC的格式也是一种业界标准。因此，这一章向读者介绍主要的时序约束理论知识。
第7章串扰噪声
集成电路进入超深亚微米设计后，串扰噪声已经成为影响芯片功能和性能的重要原因之一，因此合理解决串扰噪声带来的不利影响是当前集成电路设计必须面对的越来越重要的问题。因此，这一章向读者介绍时序分析中串扰噪声的基本理论和相关的分析技术。
第8章单元时序建模实战
原理图和版图设计完成后，时序分析工具需要读取该设计的时序信息，如综合工具需要知道模块的逻辑功能、单元实际的输入负载电容、不同输入斜率和输出负载情况下单元的延时与功耗，以及单元的面积等，单元时序信息特征化就是用模拟仿真器来提取设计模块有关以上信息的过程。通过时序信息特征化来提供设计模块的时序数据，以供多种时序分析工具使用。因此，这一章向读者介绍标准单元特征化设计在实际工程应用中的基本设计技术。
第9章静态时序分析实战（ETS篇）
