(特价书)Xilinx FPGA/CPLD设计手册
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内容简介
书籍 计算机书籍
《Xilinx FPGACPLD设计手册》从初学者的角度出发，以全新的视角、合理的布局系统地介绍了Xilinx FPGA／CPLD的设计流程，以及集成设计工具ISEl0．x的基本使用方法和技巧，并提供了一些经典设计实例，供读者学习和参考。
《Xilinx FPGACPLD设计手册》共14章，循序渐进地介绍了ISE 10.x中各种设计工具的基本操作方法，内容包括设计输入工具的使用、基于ModelSim的设计仿真、Synplify Pro和XST综合工具的使用、设计实现、器件配置以及在线调试等，并辅以4个综合实例，让读者能更加深入地理解Xilinx FPGA／CPLD的设计流程。随书附带的光盘中提供了书中所有示例的完整工程文件和设计源文件，读者可以结合书本上的实例操作流程，自行操作练习，以加深理解。
《Xilinx FPGACPLD设计手册》内容系统，实用性、专业性强，是Xilinx FPGA／CPLD设计初学者入门和提高的学习宝典。《Xilinx FPGACPLD设计手册》可以作为高等院校通信工程、电子工程、微电子和半导体学等工科专业的教材，也可以作为FPGA电子设计工程师的实用参考书。
目录
《Xilinx FPGACPLD设计手册》
第1章Xilinx FPGA／CPLD简介
1.1逻辑器件概述
1.2 FPGA简介
1.3CPLD简介
1.4 FPGA／CPLD的特点
1.5CPLD与FPGA的区别
1.6 Xilinx简介
1.6.1Xilinx公司概述
1.6.2Xilinx FPGA／CPLD器件
1.7Xilinx FPGA／CPLD的基本结构
1.7.1Xilinx CPLD的基本结构
1.7.2Xilinx FPGA的基本结构
1.8小结
第2章ISE系统简介
2.11SE系列产品的特点
2.1.1ISE特点综述
2.1.2ISE10.x新增特性
2.2 ISE10.x支持的器件
2.3 ISE的软件系列
2.41SE的系统配置和安装
2.4.1推荐的系统配置
2.4.2ISE的安装
2.5ISE设计流程实例：32位加／减法器设计
2.5.1ISE10.x集成开发环境界面
2.5.2设计输入
2.5.3功能仿真
2.5.4设计综合
2.5.5工程实现
2.5.6时序仿真
2.5.7器件配置
2.6小结
第3章ISE工程管理与设计输入
3.11SE工程管理器——Project Navigator
3.1.1Project Navigator简介
3.1.2实例3-1：使用Project Navigator创建并管理工程
3.2HDL语言输入工具——HDLE曲叮
3.2.1HDL Editor综述
3.2.2源代码输入助手——Language Templates
3.2.3实例3-2：使用HDL Editor设计16位移位寄存器
3.3状态机输入工具——StateCAD
3.3.1StateCAD简介
3.3.2实例3-3：使用StateCAD设计加法器
3.4原理图输入工具——ECS
3.4.1ECS简介
3.4.2基于ECS的混合设计方法
3.51P核生成工具——CORE Generator
3.5.1CORE Generator简介
3.5.2实例3-4：使用CORE Generator生成BlockRAM
3.6测试激励生成器——HDL Bencher
3.6.1HDLBencher简介
3.6.2实例3-5：使用HDLBencher生成测试激励
3.7设计结构向导——Architecture Wizard
3.7.1Architecture Wizard简介
3.7.2实例3-6：使用AArchitecture Wizard生成DCM
3.8小结
第4章功能仿真工具
4.1ModelSim简介
4.1.1ModelSim的安装
4.1.2ModelSim的用户界面
4.2MOdelSim仿真流程
4.2.1启动MOdelSim
4.2.2编译ModelSim仿真库
4.2.3编译源代码
4.2.4执行仿真
4.3ModelSim中的调试方法
4.3.1源文件窗口调试
4.3.2波形窗口调试
4.3.3列表窗口调试
4.3.4数据流窗口调试
4.3.5存储器窗口调试
4.4ModelSim仿真进阶
4.4.1批处理仿真
4.4.2WLF文件和波形比较
4.4.3代码覆盖率检测
4.4.4SDF时序反标
4.4.5VCD文件应用
4.5后仿真实例
4.6小结
第5章ISE综合工具
5.1Synplify／Synplify Pro综合工具
5.1.1Synplify／Synplify Pro的功能与特点
5.1.2Synplify Pro的用户界面
5.1.3实例5-1：Synplify Pro综合流程
5.2Xilinx内嵌的综合工具——XST
5.2.1XST综述
5.2.2XST综合属性设置
5.2.3实例5-2：XST综合流程
5.3全局时钟和第二全局时钟资源
5.3.1全局时钟资源简介
5.3.2Xilinx全局资源的使用方法
5.3.3第二全局时钟资源
5.4小结
第6章约束设置
6.1时序约束基础
6.1.1周期约束
6.1.2偏移约束
6.1.3专用约束
6.1.4分组约束
6.2约束编辑器——Constraints Editor
6.2.1Constraints Editor用户界面
6.2.2实例：在ConstraintsEditor中附加约束
6.3引脚与区域约束编辑器——Floorplan Editor
6.3.1利用Floorplan完成引脚配置和区域约束
6.3.2利用PACE进行引脚分配
6.4约束文件
6.4.1约束文件简介
6.4.2UCF、NCF文件的基本语法规则
6.4.3引脚和区域约束语法
6.5小结
第7章设计实现
7.1布局规划器———P100rpl皿ner
7.1.1Floorplanner的用户界面
7.1.2Floorplanner的特点及作用
7.1.3Floorplan设计流程
7.1.4实例7-1：布局规划实例
7.2FPGA底层编辑器——FPGA Editor
7.2.1FPGA Editor用户界面
7.2.2FPGA Editor的作用
7.2.3FPGA Editor输入／输出文件
7.2.4FPGA Editor设计流程
7.2.5实例7-2：FPGA Editor设计实例
7.3小结
第8章辅助设计工具
8.1时序分析器——Timing Analyzer
8.1.1时序分析基础
8.1.2Timing Analyzer简介
8.1.3实例8-1：时序分析器使用实例
8.2虚拟逻辑分析仪——ChipScope Pro
8.2.1ChipScope Pro综述
8.2.2ChipScope Pro核的使用
8.2.3ChipScope Pro Analyzer使用简介
8.2.4实例8-2：基于ChipScope Pro Core Inserter在线调试实例
8.2.5实例8-3：基于CORE Generator的在线调试示例
8.3功耗分析器———XPower
8.3.1XPower综述
8.3.2XPower用户界面
8.3.3实例8-4：XPower功耗分析实例
8.4小结
第9章Xilinx器件酉2置
9.1Xilinx器件配置简介
9.2配置流程
9.3 Xilinx器件配置模式
9.3.1主串模式
9.3.2从串模式
9.3.3字节宽度外部接口并行配置(BPI)模式
9.3.4JTAG模式
9.4 Xilinx器件配置下载电缆
9.5程序下载器——iMPACT
9.5.1iMPACT综述
9.5.2iMPACT用户界面
9.5.3iMPACT程序下载实例
9.6小结
第10章FPGA系统设计原则和技巧
10.1时钟管理模块使用技巧
10.1.1DCM模块
10.1.2实例：DCM设计实例
10.2FPGA系统设计的基本原则
10.2.1面积与速度的平衡互换原则
10.2.2硬件可实现原则
10.2.3同步设计原则
10.3FPGA系统设计的常用技巧
10.3.1乒乓操作技巧
10.3.2串并／并串转换技巧
10.3.3硬件流水线设计技巧
10.4小结
第11章综合实例1——FIFO设计
11.1FIFO的基本原理
11.2 FIFO的空／满检测
11.3Gray码
11.4异步FIFO代码设计
11.5异步FIFO代码仿真验证
11.6异步FIFO代码综合
11.7异步FIFO设计实现
11.8小结
第12章综合实例2——SPI总线设计
12.1SPI总线概述
12.2SPI总线源代码设计
12.3SPI设计综合
12.4 SPI设计的FPGA实现
12.5小结
第13章综合实例3——NAND Flash控制器设计
13.1NAND Flash简介
13.2 NAND Flash的结构和基本操作
13.3 NAND Flash控制器结构
13.4ECC模块设计
13.5生成双端口RAM
13.6 NAND Flash控制器代码设计
13.7 NAND Flash控制器代码仿真
13.8 NAND Flash控制器代码综合
13.9 NAND Flash控制器代码实现
13.10小结
第14章综合实例4——CRC校验器设计
14.1CRC校验原理
14.2 CRC校验器的结构
14.3CRC校验器源代码设计
14.4CRC校验器代码综合及仿真验证
14.5CRC校验器的FPGA实现
14.6小结
附录IC和FPGA专业术语中／英文对照
